1樓：jie源
上拉是指通過一個連線在io口可電源之間的電阻將不確定或高電平驅動能力不夠的電位控制在高電平。上拉電阻越大，驅動能力越強，抗干擾能力越強，功耗也越大。在高速電路中，對訊號上升沿有一定的抑制作用，需要注意。
上拉電阻一般取值在1kω~10kω之間。
弱上拉和強上拉的說法不是很規範！上拉電阻阻值小時，可稱為強上拉，反之，稱為弱上拉。
弱上拉就是當輸出高電平時，能夠輸出的電流很小，很容易被別的強下拉拉低，因而叫做弱上拉。例如上拉電流為幾百ua這樣子。上拉電阻的大小來決定上拉能力，小電阻強上拉，大電阻弱上拉。
擴充套件資料：
通俗易懂談"上拉電阻"與"下拉電阻"：
所謂上拉電阻就是：將一個不確定訊號（高或低電平），通過一個電阻與電源vcc相連，固定在高電平；
同理下拉電阻就是：將一個不確定訊號（高或低電平），通過一個電阻與地gnd相連，固定在低電平。
1、上拉電阻與下拉電阻用在什麼場合？
答：用在數位電路中，存在高低電平的場合。
2、上拉電阻與下拉電阻怎麼接線？
答：上拉電阻：電阻一端接vcc，一端接邏輯電平接入引腳(如微控制器引腳)
下拉電阻：電阻一端接gnd，一端接邏輯電平接入引腳(如微控制器引腳）
上拉電阻與下拉電阻的作用
1、提高輸出引腳的驅動能力：
例如，當stm32的cpu引腳輸出高電平，但由於後續電路的影響，輸出的高電平不高，就是達不到vcc，影響電路工作。所以要接上拉電阻（其實就是增加導線的輸出電流）。下拉電阻情況相反，讓stm32的cpu引腳輸出低電平，結果由於後續電路影響輸出的低電平達不到gnd（其實就是降低導線的輸出電流），所以接個下拉電阻。
2、 在引腳電平不定的時候，讓後面有一個穩定的電平：
例如，以接上拉電阻舉例，在stm32剛上電的時候，晶片引腳電平是不定的，特別引腳是接按鍵的時候，必須給他個確定的電平，下拉電阻的作用就是如果前面的引腳電平不定的話，強制讓電平保持在高電平。
3、防止引腳懸空，否則會容易產生積累電荷,靜電荷，造成電路不穩定。
1、按鍵的上拉電阻為什麼是10k歐姆？
答：按鍵的上拉電阻可以是3.3k、4.
7k、5.1k、10k都可以，但是電阻越小功耗越大，在現在的智慧生態下，我們做追求的是低功耗，高效率，10k是大多數智慧產品晶片所能識別到的引腳電流，如果電阻太大，電流太小，引腳識別不了，所以10k是個折中的方案。
2樓：這是你的公仔
上下拉電阻的阻值決定了邏輯電平轉換的沿的速度。阻值越大，速度越低功耗越小。反之亦然。--博納雨田
被上與強上有區別嘛
3樓：白蘭花豔
當然有區別。
前者說的是一般情況
很可能是自願的。
而後者說的情況是特殊情況，
可以肯定是不自願，被迫的
4樓：怎樣找情人
當然有 也可以說沒有 願意與不願意 舒不舒服 有沒有滿足 爽互不爽 舒服與爽了也可能就願意了
5樓：匿名使用者
自願和非自願，你想哪種?
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沒有區別抄，拉伸強度一般指 抗拉強襲度。抗拉強度 baitensile strength 是金屬由均du勻塑zhi性形變向區域性集中塑dao 性變形過渡的臨界值，也是金屬在靜拉伸條件下的最大承載能力。抗拉強度即表徵材料最大均勻塑性變形的抗力，拉伸試樣在承受最大拉應力之前，變形是均勻一致的，但超出之後...
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